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赵若思
2022-12-05 16:20
重庆大学 单片机
发布于重庆
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数字IC、嵌入式找日常实习
目前重庆大学研一在读,请问在成都、重庆或者杭州有合适的
#我的实习日记#
有日常实习吗?
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小燕子穿花衣
北京教育学院 电气工程师
求职区看看?
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发布于 2022-12-05 22:58
北京
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10-06 15:53
华中科技大学 集成电路IC设计
小米数字IC设计技术面经
岗位: SOC设计工程师 (已收到意向)时间: 约50分钟这次面试官非常注重考察候选人对过往设计经验的深度理解和思考,不只是问“做了什么”,而是反复追问“为什么这么做”以及“还能怎么做”。一、 技术深度考察方向面试的核心是围绕简历上的项目经历,从不同维度进行提问,考察基本功和设计思维。系统架构与设计能力:要求阐述一个你负责的、最复杂的数字系统的顶层架构。 深入探讨系统内的总线设计,比如主次总线的选择、协议的考量以及不同总线间的桥接。 关于多时钟域的设计,会提问时钟方案是如何规划的,以及为什么选择特定的频率,考察对时钟和功耗平衡的理解。 性能与时序收敛能力:要求分析自己设计中,时序最紧张的路径出...
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09-21 17:41
哈尔滨工业大学 集成电路IC设计
寒武纪数字ic设计二面
一大早上9点开始,是一个女面试官,没有自我介绍,没有八股,直接讲项目,挑一个你觉得最能体现你水平的项目讲讲。由于主包确实没做过什么很有水平的模块,都是些简单的模块,于是就对着框图开始讲。每个子模块的设计逻辑,用途,频率,验证的golden case,综合约束写了什么,如果不对异步路径约束会有什么问题,最近学了什么新的工具,什么学的。反问,后面还有没有三面,面试官急着赶下一场,时间比较紧。
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09-20 15:07
门头沟学院 数据分析师
瑞芯微一面—数字IC设计工程师
一面是技术面,1v1,聊了大概45min左右 首先自我介绍,介绍完了之后面试官沉默了一下,然后就考察项目了。 介绍一个最值得讨论的项目背景(只介绍背景),然后让我对着项目电路框图简单介绍数据流,某个具体模块的功能 八股参考1.功耗分类,以及具体含义2.从RTL层面如何降低静态功耗3.是否了解cache4.在写状态机的时候,如果下一个状态跳转有50个分支,应该如何优化
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09-21 11:18
内蒙古大学 模拟IC设计
联发科数字ic设计一面
base:合肥第一次遇到三个面试官,还好三个面试官都挺好的,联发科比较注重比赛经历跟实习经历,刚好也是问了这两个项目,开个共享画一些框图还是挺方便的。总共45min,没有怎么问八股。该说不说的,老家那边的公司面试起来就是舒服,其中一个面试官用的老家话沟通,毫无障碍,太感动了,很亲切,希望还有后续吧。反问了一些主营业务,挺广泛的👍不愧是全球前十
发面经攒人品
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10-06 16:01
华中科技大学 集成电路IC设计
芯原数字IC设计技术面经
岗位: 数字IC前端设计 (已收到意向)面试轮次: 共三轮技术面试整体感受:芯原的面试非常务实、技术深度很足。面试官会基于你的项目经验,延伸考察从系统架构、性能优化到后端流程等全方位的能力,尤其注重对设计“权衡 (Trade-off)”和实际问题解决能力的考察。第一轮技术面面试焦点: 侧重于对单个IP设计的深度、PPA优化细节和设计基本功的考察。低功耗设计与权衡:要求详细阐述一个低功耗项目的设计方案,包括要解决的功耗瓶颈是什么。追问为了实现极致的低功耗(如全局时钟关断),牺牲了哪些性能(如唤醒延迟、数据丢失风险)。如何通过设计来弥补或管理这些牺牲,例如提供可配置的工作模式。PPA (功耗、性能...
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