题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL27 |
不重叠序列检测
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-07-20
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2023-07-19
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答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2023-07-19
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答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2023-07-15
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答案正确
| < 1ms | 0K | Verilog | |
VL20 |
256选1选择器
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2023-07-15
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答案正确
| < 1ms | 0K | Verilog | |
VL19 |
五到一选择器
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2023-07-15
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答案正确
| < 1ms | 0K | Verilog | |
VL18 |
多位信号xnor
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2023-07-15
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答案正确
| < 1ms | 0K | Verilog | |
VL17 |
三元操作符
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2023-07-15
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答案正确
| < 1ms | 0K | Verilog | |
235491 |
使用握手信号实现跨时钟域数据传输
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2023-06-05
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2023-06-05
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答案正确
| < 1ms | 0K | Verilog |
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