欣兰 level
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山东大学
2025
FPGA工程师
IP属地:湖南
半死微活,小事烧纸,大事刨坟
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2024-10-30 23:08
山东大学 FPGA工程师
25届提前批-FPGA工程师(深圳)2024-07-05 (G,被刷)25届提前批-FPGA工程师(西安)2024-06-28 (8.6笔试,8.18约面,8.21一面,8-26二面)2024-10-30 (三面、终面)🤪 背景本科双非/硕士985硕本人的经历是(研电赛技术赛国二+企业赛第二名、研数模赛国三(本科国一),均团队主战+队长,两项发明专利+一软著),无实习经历,4段项目经历偏FPGA数字信号处理+高速接口。🤔 面试感受二面HR面大概40+分钟(不是。。。。时隔两个月,我真没想到,我居然能被捞起来,我以为g了)。总体而言,诺瓦星云三面感觉一般,没聊什么技术,还给开了白菜价。首先,面试官来了个自我介绍,然后我的自我介绍(大概三四分钟吧),介绍完了以后,开始拷打,问我家哪里的,对工作地有什么想法,有没有女朋友,问我保研为什么来山大,问我最熟悉哪块芯片,问我对应资源,问我项目用了多少资源,能不能用其他的替代,还问了我的offer情况,然后PUA我说其他offer开不出来,最后给讲了他们薪资组成及年终情况,问我的一个预期薪资,我想了一会还没说,他给我报了白菜,问我能不能接受(我介绍个danm),我没立马回复,他问我要多久,我说三五天给他回复,他说好,让我1号给他回复,拖着吧,加了他联系方式,再去a一下吧,a不动就拒了,mad。
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2024-10-27 20:41
山东大学 FPGA工程师
2024-09-xx(忘记哪天投递的了😅)2024-09-25 (8.6笔试)2024-09-27 (一面)2024-10-08 (二面)🤪 背景本科双非/硕士985硕本人的经历是(研电赛技术赛国二+企业赛第二名、研数模赛国三(本科国一),均团队主战+队长,两项发明专利+一软著),无实习经历,4段项目经历偏FPGA数字信号处理+高速接口。🤔 面试感受一面技术HR面大概30分钟,是一个看起来年龄不大的工程师,面试的时候我发现,好像和我做的不是很对口😅,他们做芯片封装测试的,大意了,报错岗位了?就抱着来都来了的心态面完了,总体来说还不错的。首先,自我介绍(大概三四分钟吧),介绍完了以后,就是让我介绍一下我最熟悉的一个项目,介绍完他就说他们做的可能和我做的可能不太一样或者说,他们组不是做数字逻辑或者FPGA的😅(尴尬了不是😅),他们是做DDR封装测试的,正好看见我项目里有ddr,疯狂拷打DDR,都快拷打糊了,从定义(什么是DDR),到原理,再到应用,我说我主要是xilinx的DDR的IP去做存储,后面才没拼命拷打,捡回一条小命,真的给我拷打的汗流浃背😅,后面就正常反问流程,工作强度之类的,他让我回去考虑一下要不要做这份工作毕竟第一份工作对一个人挺重要的,大哥挺好的,点赞。总体来说面试感觉还不错,面试官水平很高,人也不错。
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2024-10-27 19:51
山东大学 FPGA工程师
2024-09-xx(忘记哪天投递的了😅)2024-09-25 (8.6笔试)2024-09-27 (一面)🤪 背景本科双非/硕士985硕本人的经历是(研电赛技术赛国二+企业赛第二名、研数模赛国三(本科国一),均团队主战+队长,两项发明专利+一软著),无实习经历,4段项目经历偏FPGA数字信号处理+高速接口。🤔 面试感受一面技术HR面大概30分钟,是一个看起来年龄不大的工程师,面试的时候我发现,好像和我做的不是很对口😅,他们做芯片封装测试的,大意了,报错岗位了?就抱着来都来了的心态面完了,总体来说还不错的。首先,自我介绍(大概三四分钟吧),介绍完了以后,就是让我介绍一下我最熟悉的一个项目,介绍完他就说他们做的可能和我做的可能不太一样或者说,他们组不是做数字逻辑或者FPGA的😅(尴尬了不是😅),他们是做DDR封装测试的,正好看见我项目里有ddr,疯狂拷打DDR,都快拷打糊了,从定义(什么是DDR),到原理,再到应用,我说我主要是xilinx的DDR的IP去做存储,后面才没拼命拷打,捡回一条小命,真的给我拷打的汗流浃背😅,后面就正常反问流程,工作强度之类的,他让我回去考虑一下要不要做这份工作毕竟第一份工作对一个人挺重要的,大哥挺好的,点赞。总体来说面试感觉还不错,面试官水平很高,人也不错。
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2024-10-29 12:33
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