人工**受害者 level
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中国科学院计算技术研究所
2021
C++
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234351
边沿检测
2024-05-20
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Verilog
234350
ROM的简单实现
2024-05-20
答案正确
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Verilog
234316
根据状态转移图实现时序电路
2024-05-20
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2024-05-20
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2024-05-20
答案正确
< 1ms
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Verilog
234314
数据选择器实现逻辑电路
2024-05-17
答案正确
< 1ms
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Verilog
234312
使用3-8译码器①实现逻辑函数
2024-05-17
答案正确
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Verilog
234311
实现3-8译码器①
2024-05-17
答案正确
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Verilog
234313
用3-8译码器实现全减器
2024-05-17
答案正确
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Verilog
234310
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
2024-05-17
答案正确
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Verilog
234309
优先编码器Ⅰ
2024-05-17
答案正确
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Verilog
234309
优先编码器Ⅰ
2024-05-17
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2024-05-17
答案正确
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Verilog
234307
优先编码器电路①
2024-05-17
答案正确
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Verilog
234307
优先编码器电路①
2024-05-17
答案正确
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Verilog
234306
4bit超前进位加法器电路
2024-05-17
答案正确
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Verilog
234306
4bit超前进位加法器电路
2024-05-16
答案正确
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Verilog
234305
4位数值比较器电路
2024-05-16
答案正确
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Verilog
234305
4位数值比较器电路
2024-05-16
答案正确
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Verilog
234349
使用函数实现数据大小端转换
2024-05-16
答案正确
< 1ms
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Verilog

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