牛客46417796号 level
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武汉理工大学
2023
FPGA工程师
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VL31
数据累加输出
2022-06-26
答案正确
< 1ms
0K
Verilog
VL30
数据串转并电路
2022-06-25
答案正确
< 1ms
0K
Verilog
VL30
数据串转并电路
2022-06-25
答案正确
< 1ms
0K
Verilog
VL28
输入序列不连续的序列检测
2022-06-22
答案正确
< 1ms
0K
Verilog
VL29
信号发生器
2022-06-21
答案正确
< 1ms
0K
Verilog
VL27
不重叠序列检测
2022-06-14
答案正确
< 1ms
0K
Verilog
VL27
不重叠序列检测
2022-06-14
答案正确
< 1ms
0K
Verilog
234351
边沿检测
2022-06-14
答案正确
< 1ms
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Verilog
VL26
含有无关项的序列检测
2022-06-13
答案正确
< 1ms
0K
Verilog
VL25
输入序列连续的序列检测
2022-06-13
答案正确
< 1ms
0K
Verilog
234351
边沿检测
2022-06-13
答案正确
< 1ms
0K
Verilog
234350
ROM的简单实现
2022-06-13
答案正确
< 1ms
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Verilog
234316
根据状态转移图实现时序电路
2022-06-11
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2022-06-10
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2022-06-10
答案正确
< 1ms
0K
Verilog
234308
用优先编码器①实现键盘编码电路
2022-06-02
答案正确
< 1ms
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Verilog
234307
优先编码器电路①
2022-05-23
答案正确
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Verilog
234306
4bit超前进位加法器电路
2022-05-20
答案正确
< 1ms
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Verilog
234305
4位数值比较器电路
2022-05-20
答案正确
< 1ms
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Verilog
234349
使用函数实现数据大小端转换
2022-05-17
答案正确
< 1ms
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Verilog

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