题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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235509 |
脉冲同步器(快到慢)
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2022-05-16
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答案正确
| < 1ms | 0K | Verilog | |
235491 |
使用握手信号实现跨时钟域数据传输
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2022-05-16
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答案正确
| < 1ms | 0K | Verilog | |
235491 |
使用握手信号实现跨时钟域数据传输
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2022-05-16
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2022-05-15
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答案正确
| < 1ms | 0K | Verilog | |
VL40 |
占空比50%的奇数分频
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2022-05-15
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答案正确
| < 1ms | 0K | Verilog | |
VL40 |
占空比50%的奇数分频
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2022-05-15
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答案正确
| < 1ms | 0K | Verilog | |
234307 |
优先编码器电路①
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2022-03-08
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答案正确
| < 1ms | 0K | Verilog | |
234305 |
4位数值比较器电路
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2022-03-08
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2022-03-08
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234348 |
使用子模块实现三输入数的大小比较
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234347 |
使用generate…for语句简化代码
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234347 |
使用generate…for语句简化代码
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234347 |
使用generate…for语句简化代码
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234347 |
使用generate…for语句简化代码
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234345 |
多功能数据处理器
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234346 |
求两个数的差值
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog | |
234345 |
多功能数据处理器
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2022-03-07
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答案正确
| < 1ms | 0K | Verilog |
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