青蛙小弟很给力 level
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北京邮电大学
2025
FPGA工程师
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234313
用3-8译码器实现全减器
2025-07-29
答案正确
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Verilog
234312
使用3-8译码器①实现逻辑函数
2025-07-29
答案正确
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Verilog
234311
实现3-8译码器①
2025-07-29
答案正确
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Verilog
234310
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
2025-07-29
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2025-07-29
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2025-07-29
答案正确
< 1ms
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Verilog
234309
优先编码器Ⅰ
2025-07-29
答案正确
< 1ms
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Verilog
VL30
数据串转并电路
2024-10-17
答案正确
< 1ms
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Verilog
VL28
输入序列不连续的序列检测
2024-10-17
答案正确
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Verilog
VL27
不重叠序列检测
2024-10-17
答案正确
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Verilog
VL27
不重叠序列检测
2024-10-17
答案正确
< 1ms
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Verilog
VL25
输入序列连续的序列检测
2024-09-18
答案正确
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Verilog
VL49
脉冲同步电路
2024-09-18
答案正确
< 1ms
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Verilog
VL25
输入序列连续的序列检测
2024-06-06
答案正确
< 1ms
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Verilog
VL41
任意小数分频
2024-05-23
答案正确
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Verilog
VL34
整数倍数据位宽转换8to16
2024-05-23
答案正确
< 1ms
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Verilog
VL33
非整数倍数据位宽转换8to12
2024-05-23
答案正确
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Verilog
VL32
非整数倍数据位宽转换24to128
2024-05-23
答案正确
< 1ms
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Verilog
VL30
数据串转并电路
2024-05-23
答案正确
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Verilog
VL28
输入序列不连续的序列检测
2024-05-23
答案正确
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Verilog

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