逻辑挖坑人 level
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天津大学
2024
FPGA工程师
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NC61
两数之和
2023-03-27
答案正确
52ms
6796K
C++
VL28
输入序列不连续的序列检测
2023-03-05
答案正确
< 1ms
0K
Verilog
VL28
输入序列不连续的序列检测
2023-03-05
答案正确
< 1ms
0K
Verilog
VL26
含有无关项的序列检测
2023-03-05
答案正确
< 1ms
0K
Verilog
234350
ROM的简单实现
2023-03-04
答案正确
< 1ms
0K
Verilog
234316
根据状态转移图实现时序电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234316
根据状态转移图实现时序电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234315
根据状态转移表实现时序电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234315
根据状态转移表实现时序电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234315
根据状态转移表实现时序电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234314
数据选择器实现逻辑电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234312
使用3-8译码器①实现逻辑函数
2023-03-04
答案正确
< 1ms
0K
Verilog
234311
实现3-8译码器①
2023-03-04
答案正确
< 1ms
0K
Verilog
234310
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
2023-03-04
答案正确
< 1ms
0K
Verilog
234309
优先编码器Ⅰ
2023-03-04
答案正确
< 1ms
0K
Verilog
234308
用优先编码器①实现键盘编码电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234307
优先编码器电路①
2023-03-04
答案正确
< 1ms
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Verilog
234306
4bit超前进位加法器电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234305
4位数值比较器电路
2023-03-04
答案正确
< 1ms
0K
Verilog
234349
使用函数实现数据大小端转换
2023-03-03
答案正确
< 1ms
0K
Verilog

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