材料转验证，入行后谈谈IC验证工程师的一天究竟都在干啥？
那么我们验证工程师的一天具体都在干啥？
1、项目需求确定后，首先要先看spec、学习协议，来编写硬件概要验证方案文档，评估，预计验证需要花费的时间。
2、开会讨论，一般由Leader定下方案，下面的验证工程师负责执行。
3、根据spec，以及相关协议。详细书写验证计划，确定需要验证的功能点。有必要的话，可能还需要自己搭建验证环境。
验证工程师必备的技能，System verilog和UVM这时候就开始派上用场了，根据验证计划、Coding代码、生产test case，执行验证。
数字电路设计发展到这个阶段，不管是电子设计自动化工具（EDA），还是验证语言，验证方法学，促使验证工作中能接触到的实际电路越来越少，或者说根本就接触不到底层的电路，反而更像是一个程序员（也许是自己才疏学浅产生的认知）。
熟练掌握SV和UVM，根据验证计划写test case其实没有多大难度，我认为验证的难在于验证平台的搭建、脚本搞不定、各种协议理不清，也难在SV、UVM基础太烂就上手。
Test case写完了就完事了？不存在的，写好test case之后，你会进入一个漫长的调试环节（debug），你要是遇见一个很优秀的RTL，倒是可以省去你的很多时间；但你要是遇见一堆很烂的RTL,那你就得好好调试，看波形，修case。一路顺畅还好说，要是碰到源源不断的问题，那就得加班。
正所谓，久坐不觉茶水凉，起身方知尿意浓，debug的过程是最为煎熬的，也是设计和验证存在扯皮的地方。
平均一周内正式开会不少于两次，和其他工程师大大小小的交流也会有很多。
干项目有紧的时候，当然也有松的时候。并不是什么时间都要996，高度紧张的工作长时间下去肯定受不了呀；当一个项目干完，另一个项目还没启动，就可以享受一段Tapout Holiday，这段时间就可以过着965的规律惬意生活。
当然啦，跑tese case有时候也是很消耗时间的，在这个时间当中，和同事扯淡谈人生吹牛皮，摸鱼冲浪逗虾也是没问题的。
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