题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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NC78 |
反转链表
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2022-08-25
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答案正确
| 3ms | 544K | C++ | |
NC78 |
反转链表
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2022-08-25
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答案正确
| 4ms | 604K | C++ | |
234332 |
移位运算与乘法
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2022-08-23
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答案正确
| < 1ms | 0K | Verilog | |
234331 |
奇偶校验
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2022-08-23
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答案正确
| < 1ms | 0K | Verilog | |
234330 |
异步复位的串联T触发器
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2022-08-23
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答案正确
| < 1ms | 0K | Verilog | |
234329 |
四选一多路器
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2022-08-23
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答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234314 |
数据选择器实现逻辑电路
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2022-04-15
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答案正确
| < 1ms | 0K | Verilog | |
234312 |
使用3-8译码器①实现逻辑函数
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234311 |
实现3-8译码器①
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234313 |
用3-8译码器实现全减器
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234310 |
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234310 |
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234309 |
优先编码器Ⅰ
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234308 |
用优先编码器①实现键盘编码电路
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
234308 |
用优先编码器①实现键盘编码电路
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog |
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