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愉快的小山竹希望offer多多
10-12 09:06
哈尔滨工业大学 IC验证工程师
发布于广东
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小鹏IP验证值得签吗
昨天开了小鹏的IP验证岗,base深圳,有UU了解吗?学校三方开了,好多都在逼签
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在摸鱼的牛牛很积极
门头沟学院 集成电路IC设计
什么薪资呢、什么方向
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发布于 10-15 13:09
陕西
暂无评论,快来抢首评~
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10-06 15:53
华中科技大学 集成电路IC设计
小米数字IC设计技术面经
岗位: SOC设计工程师 (已收到意向)时间: 约50分钟这次面试官非常注重考察候选人对过往设计经验的深度理解和思考,不只是问“做了什么”,而是反复追问“为什么这么做”以及“还能怎么做”。一、 技术深度考察方向面试的核心是围绕简历上的项目经历,从不同维度进行提问,考察基本功和设计思维。系统架构与设计能力:要求阐述一个你负责的、最复杂的数字系统的顶层架构。 深入探讨系统内的总线设计,比如主次总线的选择、协议的考量以及不同总线间的桥接。 关于多时钟域的设计,会提问时钟方案是如何规划的,以及为什么选择特定的频率,考察对时钟和功耗平衡的理解。 性能与时序收敛能力:要求分析自己设计中,时序最紧张的路径出...
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10-18 21:05
电子科技大学 芯片研发
蔚来 芯片验证 二面面经
自我介绍完以后,面试官说一面已经了解过技术,所以基本上没问技术,问了一些行业相关的问题,全程几乎都是面试官在讲解1️⃣设计验证如何选择2️⃣目前拿到哪些offer了,怎么选择3️⃣对dpx/xp和蔚来有什么看法?剩下的基本都是面试官在讲解,蔚来的优势:1️⃣蔚来在业务上不仅有芯片和算法,还有数据2️⃣内部npu/isp等都是自研的,技术底蕴厚3️⃣第一颗5nm车规芯片4️⃣芯片部门盈利稳定,部门较独立5️⃣团队氛围不错,不盲目卷6️⃣芯片部门不裁应届7️⃣方向:soc/cpu/总线/ai core
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09-30 23:57
中国科学院高能物理研究所 FPGA工程师
#瑞芯微笔试
这是我目前做的最专业的一个笔试了岗位:数字IC设计工程师时长:120min,真的是刚好够用;题型:单选10道,20分;简答题:8道,80分;(1)单选,不太记得所有的了,写一下记得的吧:STA关键路径指的是什么? --- >最大的路径时沿;AHB总线协议里面,表示传输类型的信号?--> HTRANS;建立时间违例的改善方法?AXI哪个特性支持乱序完成?-->out of order;降低动态功耗的办法?哪个是非阻塞的总线协议?-->SPI什么叫同步时钟?--->同一个PLL产生的两个50M时钟(相位固定)(2)简答:写一个单bit脉冲信号跨时钟域的代码:同步异步F...
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10-13 23:46
哈尔滨工业大学 数字IC前端设计
数字ic/FPGA offer帮选
投票
目前收到的是投票里这三个。希望牛友帮忙看看流程中的:大疆(ic设计),海康(FPGA)泡池子的:寒武纪(ic验证),希奥端(ic设计),华为(非海思,FPGA)
offer帮选
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10-06 16:01
华中科技大学 集成电路IC设计
芯原数字IC设计技术面经
岗位: 数字IC前端设计 (已收到意向)面试轮次: 共三轮技术面试整体感受:芯原的面试非常务实、技术深度很足。面试官会基于你的项目经验,延伸考察从系统架构、性能优化到后端流程等全方位的能力,尤其注重对设计“权衡 (Trade-off)”和实际问题解决能力的考察。第一轮技术面面试焦点: 侧重于对单个IP设计的深度、PPA优化细节和设计基本功的考察。低功耗设计与权衡:要求详细阐述一个低功耗项目的设计方案,包括要解决的功耗瓶颈是什么。追问为了实现极致的低功耗(如全局时钟关断),牺牲了哪些性能(如唤醒延迟、数据丢失风险)。如何通过设计来弥补或管理这些牺牲,例如提供可配置的工作模式。PPA (功耗、性能...
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