9.2早上九点电话面，时长44分钟主要就是对我实习设计的模块进行详细提问，其中功能如何实现的，模块频率是多少。然后就是问了我的钩子问题。问有没有用过vc static，有没有写过sdc。八股：setup hold的概念，违例怎么解决然后是一些流程式问题：你如果有一个很高的目标取得成功了，你觉得归功于什么？你设计完模块后来有没有自己再复盘过，有没有什么改进的点？你自我提升自我进步的方式是怎样？你遇到过的最大的挫折是什么，怎么应对的？评价一下实习公司的优缺点，说三点你认为自己最有优势的地方然后是面试官介绍自己公司的业务，这几年流片情况用的工艺等等。反问：公司培养流程，面试表现如何（说挺不错的，等hr面期待oc

岗位是数字芯片开发，具体就是FPGA芯片开发。 这次面试是电话面试，通过短信通知的，到时间他会主动打电话来，面了快一小时。 上来先是问项目，问的很细，简历上的项目都问了一遍，但是相对没那么深，应该主要是看项目是不是自己做的。 没有手撕代码（毕竟是电话面） 但是有八股，不过不多，问了AHB和AXI这类，以及FPGA的内部组成（毕竟是做FPGA芯片的）。 base在深圳高新园，后面说是直接就hr面了。

bg双九，暑期实习主管面挂，秋招又是主管面挂。。。我想问问乐鑫的部门主管们到底想要什么样的人，个人感觉也没有啥踩雷的回答点啊，乐鑫，哈哈哈，从梦中情司到十分无语，大家投吧，我是无缘了

芯片，这次的 Verilog 题目比之前难啊，是我的错觉吗