题解 | #状态机-重叠序列检测#

状态机-重叠序列检测

https://www.nowcoder.com/practice/10be91c03f5a412cb26f67dbd24020a9

`timescale 1ns/1ns

module sequence_test2(
	input wire clk  ,
	input wire rst  ,
	input wire data ,
	output reg flag
);
//*************code***********//
	wire rst_n;
	assign rst_n = rst;
	
	reg [3:0] data_reg;
	always @(posedge clk or negedge rst_n) 
	begin
		if(~rst_n)
			data_reg <= 4'b0;
		else
			data_reg <= {data_reg[2:0], data};
	end

	always @(posedge clk or negedge rst_n) 
	begin
		if(~rst_n)
			flag <= 1'b0;
		else
			flag <= (data_reg==4'b1011);
	end

//*************code***********//
endmodule

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Lorn的意义:1.你这根本就不会写简历呀,了解太少了 2.你这些项目经历感觉真的没啥亮点啊,描述的不行,重写书写一下让人看到核心,就继续海投 注意七八月份ofer还是比较多的,越往后机会越少,抓住时机,抓紧检查疏漏,加油查看图片
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